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(简答题)

设计一个(12,4)系统卷积编码器使其约束长度v=3且d*≥8。 (1)构造该编码器的网格图。 (2)该码的dfree是什么?

正确答案

(1)由题意可知,n=12,k=4,且约束长度为v=mk0=3
可以得到m=3,k0=1,n0=3
通过这些参量我们可以设计出编码器,如下图所示:

这个编码器每次把1比特输入编码成3比特的输出。信息帧的长度为k0=1,码字帧的长度为n0=3,分组长度为12,该编码器的约束长度为v=mk0=3,码率为1/3。
编码器的状态图:(只有四种状态)

卷积编码器输入和输出的比特如下表所示

编码器的网格图为:

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    考虑由下列定义的码率为2/3的卷积码: 这个码用到格雷编码(每个符号被赋值3比特,这样一来两个相连符号的码只在一个比特位不同)的8-PSK信号集。该TCM方案的吞吐量为2bit/s/Hz。 关于吞吐量为2bit/s/Hz的无编码的QPSK,求渐近编码增益。

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    考虑由下列定义的码率为2/3的卷积码: 这个码用到格雷编码(每个符号被赋值3比特,这样一来两个相连符号的码只在一个比特位不同)的8-PSK信号集。该TCM方案的吞吐量为2bit/s/Hz。

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    请用74LS138译码器及其他门电路设计一个端口地址译码器,使CPU可以对一下地址范围寻址: (1)740H~747H; (2)750H~757H; (3)758H~75FH; (4)768H~76FH。

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