（填空题）
D触发器的逻辑功能是：CP脉冲触发有效时（）。
正确答案
QN+1=D
答案解析
略
相似试题
（单选题）
题13图所示逻辑电路中，当A=1，B=0时，CP脉冲来到后JK触发器（）。
（判断题）
同步时序逻辑电路中各触发器的时钟脉冲CP不一定相同。
（简答题）
△如图所示电路是由D触发器构成的计数器，试说明其功能；并画出与CP脉冲对应的各输出端波形。（设初始状态为000）
（简答题）
图是一个自循环移位寄存器逻辑图，触发器初始状态为100，在CP端连续输入6个时钟脉冲，用表格形式列出在6个时钟脉冲作用下3个触发器的状态变化。
（单选题）
若将维持-阻塞D触发器的D信号输入端接其Q，则此触发器在CP脉冲信号作用下为（）分频电路。
（简答题）
△如图所示电路是由JK触发器构成的计数器，试说明其功能；并画出与CP脉冲对应的各输出端波形。（设初始状态为000）
（单选题）
当维持阻塞型D触发器CP=1，D=0时，Q端（）。
（简答题）
△如图所示电路是由JK触发器构成的计数器，试说明其功能；并画出与CP脉冲对应的各输出端波形。（设初始状态为000）
（简答题）
△如图所示电路是由JK触发器构成的计数器，试说明其功能；并画出与CP脉冲对应的各输出端波形。（设初始状态为000）
